Mod. I, Unid. 1, Obj. 1 Criterio de Dominio 1/1

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1 M.R. 333 VERSION 1 Prueba Integral 1/5 UNIVERSIDAD NACIONAL ABIERTA VICERRECTORADO ACADÉMICO ÁREA INGENIERIA MODELO DE RESPUESTA ASIGNATURA: ARQUITECTURA DEL COMPUTADOR CÓDIGO: 333 MOMENTO: PRUEBA INTEGRAL VERSIÓN: 01 FECHA DE APLICACIÓN: Mod. I, Unid. 1, Obj. 1 Criterio de Dominio 1/1 1.-Como la computadora es de una sola dirección, dispone de un registro acumulador para almacenar los datos introducidos desde el teclado y capturados mediante la instrucción de máquina IN. Cada uno de los valores recibidos, se transfieren a localidades sucesivas de la memoria comenzando con la posición direccionada por DATA. La secuencia se muestra a continuación: SECUENCIA DE LAS INSTRUCCIONES IN 00H STA DATA OPERACIÓN Permite leer desde el puerto de entrada conectado al teclado, un carácter y almacenarlo en el registro acumulador de la computadora. Mediante el uso de esta instrucción el valor del carácter almacenado en el registro acumulador es transferido a la posición de memoria apuntada por DATA Criterio de Corrección: El objetivo será logrado si la respuesta del estudiante presenta una secuencia de instrucciones similar a la del modelo con su respectiva descripción de operación que cumpla con los requerimientos dados en la pregunta. La respuesta deberá estar debidamente razonada. Mod. I, Unid. 2, Obj. 2 Criterio de Dominio 1/1 2.-Como la señal proveniente del módulo de medición es del tipo analógica, se hace necesario utilizar un convertidor analógico-digital, para la construcción del circuito acondicionador de señal. La salida de

2 M.R. 333 VERSION 1 Prueba Integral 2/5 este circuito suministrará una señal digital a la tarjeta de adquisición de datos la cual podrá ser transmitida al computador para su posterior procesamiento. Criterio de Corrección: La respuesta del estudiante debe ser equivalente a la del modelo y estar debidamente razonada. Mod. I, Unid. 3 Obj. 3 CRITERIO DE DOMINIO 1/1 3.-Una vez que el proceso A ha consumido su tiempo de servicio, comienza la ejecución del Planificador de Procesos, el cual realiza las siguientes acciones: Guarda toda la información del proceso interrumpido A (denominada estado del programa), la cual incluye los contenidos de los registros, el contador del programa y la palabra de estado del procesador. Selecciona el programa B, para ser ejecutado. Restaura toda la información de estado relacionada con el proceso suspendido B. Posteriormente, el procesador ejecuta una instrucción de retorno de interrupción y en consecuencia el programa B entra en ejecución. Criterio de Corrección: Para lograr el objetivo el estudiante deberá presentar una descripción equivalente a la del modelo y debidamente razonada. Mod. II, Unid. 4, Obj. 4 Criterio de Dominio 1/1 4.-Como la computadora utiliza la representación en signo y magnitud para operar los números enteros con signo y emplea 16 bits en total para su representación, el bit más significativo se utilizará para el signo y los 15 bits restantes para la magnitud del número. De esta manera la representación de cada uno de los números será: Número entero decimal Bit de signo Bits de magnitud (valor absoluto del número en el sistema binario)

3 M.R. 333 VERSION 1 Prueba Integral 3/5 Criterio de Corrección: El objetivo será logrado si la respuesta del estudiante es equivalente a la del modelo y si está debidamente justificada. Mod. II, Unid. 5, Obj. 5 CRITERIO DE DOMINIO 1/1 5.-Para el caso dado se cumplen las siguientes condiciones: A > 0 y B < 0 a > b, siendo a y b el valor absoluto de A y B respectivamente n = número de bits = 8 Bajo estas condiciones el conjunto de pasos a desarrollar (algoritmo) para obtener el valor de C es el siguiente: 1) se suman los n bits de A y B directamente: Bit de acarreo 2) El bit de acarreo se desecha. 3) El valor de C en la representación de complemento a 2 es el siguiente: C = Criterio de Corrección: Para lograr el objetivo la respuesta del estudiante deberá ser equivalente a la del modelo y estar debidamente justificada.

4 M.R. 333 VERSION 1 Prueba Integral 4/5 Mod. II, Unid. 6 Obj. 6 CRITERIO DE DOMINIO 1/1 6.-Solución: a) Haciendo uso de las bases de los circuitos lógicos, se define a continuación las funciones lógicas para cada una de las salidas del decodificador 2 x 4 : S 0 = A 8 A 9 S 1 = A 8 A 9 S 2 = A 8 A 9 S 3 = A 8 A 9 b) Con base a las funciones lógicas determinadas en el punto anterior, se muestra a continuación, el diseño del circuito combinatorio a utilizar en la construcción del decodificador: A 9 S 3 S 2 S 1 A 8 S 0 Criterio de Corrección: Para lograr el objetivo el estudiante deberá responder correctamente a los planteamientos a y b de la pregunta, además deberá justificar su respuesta.

5 M.R. 333 VERSION 1 Prueba Integral 5/5 Mod. III, Unid. 7 Obj. 7 CRITERIO DE DOMINIO 1/1 7.-Como el bus de direcciones de la computadora es de 16 bits, es necesario cargar el registro MAR con la dirección (LOCA) donde se encuentra el dato, a continuación se muestra la tabla que resume la ejecución de la instrucción y la activación de los correspondientes pc: pc Acción 14 [ MAR ] [ PCH ], [ PCL ] 13 [ AUX ] [ MDR ] 14 [ MAR ] [ PCH ], [ PCL ] 15 [ MAR ] [ AUX ], [ MDR ] 12 [ R0 ] [ R0 ] + [ MDR ] Criterio de Corrección: Para lograr el objetivo la respuesta del estudiante debe ser equivalente a la del modelo y estar justificada. FIN DEL MODELO

Mod. I, Unid. 1, Obj. 1 CRITERIO DE DOMINIO 1/1

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