Registros de Desplazamiento. Introducción n a los Sistemas Lógicos y Digitales 2009
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- Carlos Parra Hernández
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1 Registros de esplazamiento Introducción n a los Sistemas Lógicos y igitales 2009 Sergio Noriega Introducción a los Sistemas Lógicos y igitales
2 Registro de desplazamiento: Es todo circuito que transforma un dato en formato serie a formato paralelo ó viceversa donde todas las operaciones son sincronizadas por una señal de reloj externa. Clasificaciones: Según formato de entradas-salidas: Entrada Serie-Salida Paralelo (Serial In Parallel Out). Entrada Paralelo-Salida Serie (Parallel In Serial Out). Universal (Composición de los dos anteriores). Entrada Serie-Salida Serie (usado como línea de retardo) Existen dentro de lo expuesto diferentes tipos de entradas auxiliares tales como carga (asincrónica, sincrónica ó ambas), reset asincrónico ó sincrónico, habilitación de reloj, etc. Lo mismo con las salidas: hay registros de desplazamiento (R)
3 REGISTRO SERIE-PARALELO Es aquél que convierte un string (cadena) de datos binarios en formato serie a un formato paralelo donde dichos datos se encuentran sincronizados con una señal de reloj externa. Un uso popular es dentro de la parte de recepción de un modem de comunicaciones donde la señal recibida es un tren de bits los cuales deben ser pasados a un formato paralelo a fin de poder ser procesados convenientemente por un microprocesador, el cual sólo trabaja con señales binarias en dicho formato paralelo. Está basado en una cadena de Flip-Flops tipo. Si el R es de N bits, el string de bits se hace entrar por el primero y luego de N ciclos de reloj se tiene en las N salidas de los s el dato ya convertido a paralelo.
4 REGISTRO SERIE-PARALELO de 4 bits /Reset /S /S /S /S /C /C /C /C ato In in R [3..0] out
5 REGISTRO SERIE-PARALELO R SERIE-PARALELO E 8 BITS 74HC64 TECNOLOGÍA CMOS Este registro de desplazamiento tiene dos entradas, una de las cuales se puede usar como habilitación. El reloj es activo por flanco ascendente. El rest es activo bajo y asincrónico.
6 REGISTRO SERIE-PARALELO R SERIE-PARALELO E 8 BITS 74HC64 TECNOLOGÍA CMOS
7 REGISTRO SERIE-PARALELO R SERIE-PARALELO E 8 BITS 74HC64 TECNOLOGÍA CMOS
8 REGISTRO SERIE-PARALELO R SERIE-PARALELO E 8 BITS 74HC64 TECNOLOGÍA CMOS
9 REGISTRO SERIE-PARALELO R SERIE-PARALELO E 8 BITS 74HC64 TECNOLOGÍA CMOS Esquemático Simulación con el MAX-PLUS II
10 REGISTRO PARALELO - SERIE Es aquél que convierte un dato en formato paralelo en un string (cadena) de datos binarios en formato serie, donde dichos datos se encuentran sincronizados con una señal de reloj externa. Un uso popular es dentro de la parte de transmisión de un modem de comunicaciones donde la señal recibida proviene de un microprocesador, el cual sólo trabaja con señales binarias en formato paralelo. icha información es convertida por el R en un tren de bits. Un R de N bits está basado generalmente en una cadena de N Flip-Flops tipo para la conversión de datos y un latch de N bits para la carga del dato binario al comienzo de cada sesión de transmisión. Respecto a la carga de datos en paralelo, el R puede ser del tipo carga asincrónica ó carga sincrónica.
11 REGISTRO PARALELO - SERIE P0 P P2.P(n-) /PL LÓGICA COMBINATORIA PARA CARGA ASINCRÓNICA /S /S /S out 0 /C /C /C [n-..0] in CARGA ASINCRÓNICA out R
12 REGISTRO PARALELO - SERIE CARGA ASINCRÓNICA Tabla de verdad para un /PL 0 P(i) 0 /S /C 0 P(i) /PL /S 0 0 /C 0
13 REGISTRO PARALELO - SERIE P0 P P(n-) /PL 0 0 /S 0 n- 0 /S 0 /S out /C /C /C CARGA SINCRÓNICA Nota: Por simplicidad en el esquema no se han conectado las entradas asincrónicas de los s..
14 Este R permite dos modos de funcionamiento: R PARALELO-SERIE E 8 BITS 74HC65 TECNOLOGÍA CMOS Paralelo Serie (carga sincrónica) Serie - Serie
15 R PARALELO-SERIE E 8 BITS 74HC65 TECNOLOGÍA CMOS
16 R PARALELO-SERIE E 8 BITS 74HC65 TECNOLOGÍA CMOS Modo normal de R Modo carga paralelo Sincrónico
17 R PARALELO-SERIE E 8 BITS 74HC65 TECNOLOGÍA CMOS
18 R PARALELO-SERIE E 8 BITS 74HC65 TECNOLOGÍA CMOS Este R tiene carga sincrónica activa en bajo. Se usa la misma entrada para definir el modo de funcionamiento: -Carga de datos ( 0 ). -Modo normal de uso ( ). La señal de reloj puede ser inhibida con una entrada adicional Clock Inhibit. Se dispone de dos salidas una y la otra su negación.
19 R BIIRECCIONAL 0 /S 0 /S Entr. er. Salida Iz. /C /C Entrada Iz. Salida er. Nota: Por simplicidad en el esquema no se han conectado, /S y/c Ia-/(aI)
20 R PARALELO-SERIE E 8 BITS 74HC65 TECNOLOGÍA CMOS R serie-paralelo ó paralelo-serie con capacidad de sentido de transferencia bidireccional (Izquierda-derecha ó viceversa).
21 R PARALELO-SERIE E 8 BITS 74HC65 TECNOLOGÍA CMOS
22 R PARALELO-SERIE E 8 BITS 74HC65 TECNOLOGÍA CMOS
23 R PARALELO-SERIE E 8 BITS 74HC65 TECNOLOGÍA CMOS
24 EJEMPLO E APLICACIÓN E R SERIE-PARALELO ato in Reloj etector de secuencia serie. Cuando el dato recibe la secuencia: 0 0 la salida de la AN se pone en durante un ciclo de reloj.
25 Bibliografía: Apuntes de teoría: Registros de esplazamiento. S. Noriega. Libros: Sistemas igitales. R. Tocci, N. Widmer, G. Moss. Ed. Prentice Hall. iseño igital. M. Morris Mano. Ed. Prentice Hall. 3ra edición. iseño de Sistemas igitales. John Vyemura. Ed. Thomson. iseño Lógico. Antonio Ruiz, Alberto Espinosa. Ed. McGraw-Hill. igital esign:principles & Practices. John Wakerly. Ed. Prentice Hall. iseño igital. Alan Marcovitz. Ed. McGraw-Hill. Electrónica igital. James Bignell, R. onovan. Ed. CECSA. Técnicas igitales con Circuitos Integrados. M. Ginzburg. Fundamentos de iseño Lógico y Computadoras. M. Mano, C. Kime. Ed. Prentice Hall. Teoría de conmutación y iseño lógico. F. Hill, G. Peterson. Ed. Limusa Manuales de CMOS de alta velocidad de Motorola, Texas Instruments, Fairchild, etc..
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